|
|
Design Retiming na HDL úrovni
Kafka, Leoš ; Matoušek, Rudolf
Článek se zabývá zlepšením časování obvodu pomocí úprav na vyšší úrovni popisu obvodu. Některé nástroje pro syntézu umožňují zlepšení časování, ale tyto techniky nejsou dostupné pro všechny architektury, například pro Atmel FPSLIC. Modifikace na úrovni HDL je nezávislá na použité architektuře a je tak jednou z možností, jak provést zlepšení časování i pro tyto architektury.
|
|
|
Rozbor a implementace dynamické rekonfigurace pro obvody FPGA
Honzík, Petr
Text popisuje platformu pro dynamickou rekonfiguraci na FPGA obvodech s vestavěným mikroprocesorem. Platforma je rozdělena na HW čast implementovanou v FPGA a na SW část prováděnou v mikroprocesoru. Ten vystupuje jako iniciátor rekonfiguračního procesu. Stará se o předání potřebných dat pro provedení rekonfigurace. HW v FPGA je navrženo jako autonomní obvod provádějící rekonfigurační proces. Konfiguračni bitstreamy a programy pro mikroprocesor jsou uloženy externí paměti připojené k FPGA.
|
|
|
Injektor poruch pro TSC obvody založený na FPGA
Kafka, Leoš
Článek se zabývá simulací poruch v úplně samočinně kontrolovaných obvodech implementovaných v FPGA. Pro simulaci poruch byl použit softwarový simulátor a hardwarový injektor, využívající dynamickou rekonfiguraci pro vkládání poruch. Článek obsahuje výsledky experimentů a porovnání obou metod.
|
|
| |
|
|
Dynamic reconfiguration of FPGAs: a case study
Matoušek, Rudolf
This paper discusses dynamic reconfiguration achievable using current FPGA methodology. An analysis of implementation issues has been presented and desirable features of future generation of CAD tools have been discussed. Several practical examples have been presented together with their implementation data.
|
|
|
Logarithmic number system and floating-point arithmetics an FPGA
Pohl, Zdeněk
An introduction to a logarithmic number system (LNS) is presented. Range and procision of this arithmetic is briefly discussed. We show that the LNS arithmetics is suitable for a FPGA implementation. A case study will compare parameters of our LNS arithmetic library to a conventional floating-point arithmetic.
|
|
|
Dynamic reconfiguration of FPGAs
Matoušek, Rudolf ; Pohl, Zdeněk ; Daněk, Martin ; Kadlec, Jiří
Dymnamic reconfiguration of FPGA devices has been an issue of the last decade. Althouth this new feature of currently available devices permits more robust and flexible designs, it has not been recognized by professionals. This paper disscussed demands placed by dynamic reconfiguration on design tools as well as on designes themselves. A case study is presented for the Atmel AT94K family and the supplied design tools, and values are provided that should aid in analyzing such designs.
|
|
|
Dynamic runtime partial reconfiguration in FPGA
Matoušek, Rudolf ; Daněk, Martin ; Pohl, Zdeněk ; Kadlec, Jiří
Runtime dynamic reconfiguration of FPGA devices has been an issue of the last decade. Although this feature permits more robust and more flexible designes and devices that posseses it are available on the market, it is not directly supported by the current design tools. This paper presents a simple design that uses true dymnamic reconfiguration for Atmel AT94K devices. The design has been implemented using a special feature of the currently available Figaro IDS5.2 tool in an innovative way.
|
|
|
Evolutionary techniques in physical design for FPGAs
Daněk, Martin ; Muzikář, Z.
This paper disscusses two studies of using evolutionary algorithms in physical design for FPGAs. The first study presents an adaptation of a genetic algorithm that optimises parametres of a linear delay model for Xilinx XC4000 FPGA and compares their performance to parameters optimised by hand. The second study showes implementation and performance of an adaptive technology mapping algorithm for XC4000 based on Wilsons XCS classifier system.
|
|
| |
host ::
RSS.